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[发明专利]乘法累加装置和乘法累加方法-CN201980045355.3在审
发明人：藤波靖;山岸弘幸 -专利权人：索尼公司
申请日： 2019-07-05 - 公布日： 2021-03-16 - 主分类号： G06G7/12 文献下载
摘要：该乘法累加装置(10)设置有比较单元(18)和控制电路(110)，比较单元将由存储在存储单元(14)中的电荷产生的电压与阈值电压进行比较，并且在电压超过阈值电压时输出输出信号，控制电路基于预设值减少从连接至存储单元
乘法累加装置方法

[发明专利]乘累加运算装置和乘累加运算方法-CN202010885067.3在审
发明人：不公告发明人 -专利权人：北京希姆计算科技有限公司
申请日： 2020-08-28 - 公布日： 2022-03-01 - 主分类号： G06F7/544 文献下载
摘要：本公开提供一种乘累加运算装置和乘累加运算方法。所述装置包括依次连接的乘法器、加法器以及第一寄存器组，第一寄存器组包括多个第一寄存器；还包括第二寄存器组，包括至少一个第二寄存器，用于使乘累加运算结果在时序上至少延长一个时钟周期；多个第一寄存器，用于根据延长的时钟周期的间隔依序接收乘累加运算结果
累加运算装置方法

[发明专利]乘法和累加电路-CN201980061815.1在审
发明人： S·派瑞克;A·霍桑加迪;B·田;A·西拉萨奥;Y·富;OF·C·费尔南德斯;M·吴;C·H·迪克 -专利权人：赛灵思公司
申请日： 2019-09-05 - 公布日： 2021-04-30 - 主分类号： G06F7/544 文献下载
摘要：用于将浮点操作数相乘的电路和方法。指数加法器电路将第一指数和第二指数相加并产生输出指数。尾数乘法器电路将第一尾数和第二尾数相乘并产生输出尾数。第一转换电路将输出指数和输出尾数转换为定点数。累加器电路将累加寄存器的内容和定点数相加为累加值，并将累加值存储在累加寄存器中。
乘法累加电路

[发明专利]乘积累加运算装置、乘积累加运算电路、乘积累加运算系统和乘积累加运算方法-CN201980045393.9在审
发明人：森江隆;山口正登志;岩元刚毅;田向权 -专利权人：索尼公司
申请日： 2019-07-04 - 公布日： 2021-02-19 - 主分类号： G06G7/60 文献下载
摘要：乘积累加运算装置利用模拟电路执行乘积累加运算，并包括：多条输入线；多个乘积单元；累加单元；充电单元；以及输出单元。具有与输入值对应的脉冲宽度的脉冲信号被输入到多条输入线。累加单元累加与由多个乘积单元中的每个乘积单元生成的乘积值相对应的电荷的和。充电单元以与累加单元的累加状态相关联的充电速度对其中已经累加了与乘积值相对应的电荷的和的累加单元进行充电。在充电单元开始充电之后，输出单元通过使用与累加单元的累加状态相关联的阈值对由累加单元保持的电压执行阈值确定来输出表示乘积值的和的乘积累加信号。
乘积累加运算装置电路系统方法

[发明专利]多字乘法－累加电路和蒙哥马利模乘法－累加电路-CN200410058173.5有效
发明人：向田健二;武仲正彦;鸟居直哉;柳井升一 -专利权人：富士通株式会社
申请日： 2004-08-13 - 公布日： 2005-08-03 - 主分类号： G06F7/52 文献下载
摘要：本发明公开了一种适用于使用单口存储器的多字乘法－累加电路和蒙哥马利模乘法－累加电路。该电路由乘法－累加(MAC)运算器和周边的寄存器组成。该MAC运算器具有位宽不同的被乘数和乘数输入端口，以计算从存储器读出的多字数据的乘积的和。寄存器用作要被提供给MAC运算器的单独的输入端口的多字数据的缓冲存储装置。对在每个时钟周期中被提供给MAC运算器的数据量被调节，使得由MAC运算器在一个时钟周期中所消耗和产生的数据总量将等于或小于存储器在一个时钟周期中所能传输的最大数据量。
多字乘法累加电路马利

[发明专利]适应前端高速处理的累加器和功率谱累加器及其累加方法-CN201711249543.7有效
发明人：陈刚;李坤贺;卢峥;蒲永材;陈航 -专利权人：中国兵器装备集团自动化研究所
申请日： 2017-12-01 - 公布日： 2021-04-02 - 主分类号： G06F7/57 文献下载
摘要：本发明公开了适应前端高速处理的累加器，累加器模块：累加器模块有输入端口A、输入端口B和输出端口，输入端口A直接与前端数据处理器件的输出接口连接并按帧数顺序获得前端数据处理器件实时更新的每一帧的原始数据，输入端口B直接与帧数判断模块的输出端口连接并获得帧数判断模块实时更新的输出数据B，累加器模块对原始数据与输出数据B进行累加计算并输出累加结果；帧数判断模块：当前端数据处理器件的输出结果信号A的帧数为X时，X大于1的正整数，帧数判断模块用于调用先进先出缓存模块中，帧数为X‑1时原始数据对应的累加结果作为输出数据B给累加器模块的输入端口B。
适应前端高速处理累加器功率及其累加方法

[发明专利]乘积累加运算装置、乘积累加运算方法和系统-CN201910706737.8在审
发明人：奥村俊介 -专利权人：瑞萨电子株式会社
申请日： 2019-08-01 - 公布日： 2020-03-17 - 主分类号： G06F17/15 文献下载
摘要：本公开的实施例涉及乘积累加运算装置、乘积累加运算方法和系统。提供了一种乘积累加计算装置、乘积累加计算方法和用于有效地执行乘积累加计算的系统。乘积累加运算装置包括多个存储器块，该多个存储器块存储多个被乘元素并且对输入数据执行乘积累加运算。每个存储器块存储多个被乘元素的相同数位的一位值。控制单元累加和相加乘积累加运算结果的值；以及数据存储器存储累加相加值作为接下来的乘积累加运算的乘元素。
乘积累加运算装置方法系统

[实用新型]XIU‑累加寄存器、XIU‑累加寄存器电路、以及电子设备-CN201720569426.8有效
发明人：修黎明 -专利权人：京东方科技集团股份有限公司
申请日： 2017-05-19 - 公布日： 2018-03-16 - 主分类号： G06F7/509 文献下载
摘要：本公开涉及一种XIU‑累加寄存器、XIU‑累加寄存器电路、以及电子设备。该XIU‑累加寄存器包括第一累加单元和第二累加单元；第一累加单元包括第一加法器和第一寄存器；第一加法器用于累加一累加变量的分数位数据，第一寄存器用于存储分数位数据的累加结果以及分数位数据的累加结果的进位数据；第二累加单元包括第二加法器和第二寄存器；第二加法器用于累加该累加变量的整数位数据，第二寄存器用于存储整数位数据的累加结果；其中，第一累加单元的第一寄存器与第二累加单元的第二加法器相连，用于将分数位数据的累加结果的进位数据在下一时钟周期传输至整数位数据以进行累加本公开可提高累加器速度、降低累加器功耗、减小累加器面积。
xiu 累加寄存器电路以及电子设备

[发明专利]一种累加数字序列的方法和装置-CN201811235111.5在审
发明人：张永伟 -专利权人：成都鼎桥通信技术有限公司
申请日： 2018-10-23 - 公布日： 2020-05-01 - 主分类号： G06F7/509 文献下载
摘要：本申请提供了一种累加数字序列的方法和装置，应用于包括两个累加器的累加装置上，该方法包括：针对任一待累加二进制数字序列，将序列中的每个数值拆分为低位和高位两个数值；低位数值的位宽为预设值W；将序列中的每个数值拆分后的低位数值输入第一累加器进行逐个累加；将序列中的每个数值拆分后的高位数值输入第二累加器进行逐个累加；当通过第一累加器和第二累加器将该序列中的所有数值累加结束后，将第一累加器的累加结果作为低W位，第二累加器的累加结果作为高位进行合并，将合并后的数值作为所述序列的累加值该方法能够有效提高累加器的时钟速率，且减少累加器的资源消耗。
一种累加数字序列方法装置

[发明专利]计算装置、乘积累加运算装置、乘积累加运算电路和乘积累加运算系统-CN201980046141.8在审
发明人：森江隆;山口正登志;田向权 -专利权人：索尼公司
申请日： 2019-07-05 - 公布日： 2021-02-26 - 主分类号： G06G7/16 文献下载
摘要：根据本技术的实施例的计算装置包括多条输入线和乘积累加运算装置。多条输入线接收电信号的输入。乘积累加运算装置包括：一对输出线；多个乘法单元，包括：加权单元，基于由多条输入线作为输入接收的电信号，生成与通过将由电信号表示的信号值乘以加权值而获得的乘积值相对应的电荷；保持单元，保持二进制状态；以及开关单元，基于保持的二进制状态，将由加权单元生成的电荷输出到一对输出线的一条；累积单元，累积由多个乘法单元输出到一对输出线的电荷；以及输出单元，基于累积的电荷，输出表示乘积值之和的乘积累加信号。
计算装置乘积累加运算电路系统

[发明专利]一种可配置的乘累加运算单元及其构成的乘累加运算阵列-CN201310632691.2有效
发明人：杨靓;周泉;曹辉 -专利权人：中国航天科技集团公司第九研究院第七七一研究所
申请日： 2013-11-28 - 公布日： 2014-03-26 - 主分类号： G06F7/544 文献下载
摘要：一种可配置的乘累加运算单元及其构成的乘累加运算阵列，该乘累加运算单元包括用于接收并存储Ain和Bin的操作数寄存级、用于Ain和Bin相乘的乘法级、及用于使乘法级的运算结果与该乘累加运算单元前一拍的运算结果或上一级乘累加运算单元的运算结果相加的加法级；加法级还接收能将运算模式调整为进位累加模式或自累加模式的模式配置。该乘累加运算阵列由多个该乘累加运算单元构成。本发明提供的乘累加运算单元和乘累加运算阵列将进位累加模式和自累加模式合二为一，能通过编程模式配置来实现不同的运算模式，应用中能跟据需要灵活配置选择运算模式来完成乘累加计算，能获得更好的计算实时性能及更高的资源利用效率
一种配置累加运算单元及其构成阵列

[发明专利]一种累加器缓冲的数据累加卸载的控制结构及方法-CN202210966617.3在审
发明人：陈庆强;张清波;王谛;石嵩;于齐 -专利权人：无锡江南计算技术研究所
申请日： 2022-08-12 - 公布日： 2022-11-01 - 主分类号： G06F7/53 文献下载
摘要：本发明涉及累加器缓冲技术领域，具体为一种累加器缓冲的数据累加卸载的控制结构及方法。一种累加器缓冲的数据累加卸载的控制结构，包括累加器缓冲控制逻辑，包括用于生成累加结果缓存信号的第一控制逻辑单元和用于生成累加结果卸载信号的第二控制逻辑单元；缓冲模块，包括控制寄存器，与所述累加器缓冲控制逻辑电性连接，用于接收并暂存所述累加结果缓存信号和累加结果卸载信号。本发明缓冲模块可以通过第一缓冲对累加结果进行缓存，同时可以对第二缓冲中已缓存的累加结果进行卸载，当一轮累加结果缓存结束后，缓冲模块可直接进入下一轮累加结果的缓存，省去了现有技术中等待累加结果卸载的时间，进而有效提高了累加器缓冲的工作效率。
一种累加器缓冲数据累加卸载控制结构方法

[发明专利]物质浓度的监控系统、方法及集散控制系统-CN202210794811.8在审
发明人：田宇;安琪 -专利权人：国能河北沧东发电有限责任公司
申请日： 2022-07-05 - 公布日： 2022-10-21 - 主分类号： G01N33/00 文献下载
摘要：本公开涉及一种物质浓度的监控系统、方法及集散控制系统，涉及测量技术领域，该系统包括：第一输入模块输入目标物质的实测浓度，第二输入模块输入设定的基准常数，第一累加模块和第二累加模块被触发信号触发后，在每个单位时间将实测浓度与上次累加后的累加浓度以及基准常数与上次累加后的常数值分别进行累加，并将得到的本次累加后的累加浓度和常数值分别向计算模块和比较模块输出，比较模块将本次累加后的常数值与预设值进行比较，并在本次累加后的常数值满足预设条件的情况下，将本次累加后的常数值输出至计算模块，计算模块根据第一累加模块接收到的本次累加后的累加浓度和本次累加后的常数值
物质浓度监控系统方法集散控制系统

[发明专利]信号捕获方法及装置-CN201510885332.7在审
发明人：王元磊;刘坤;张爽娜;董启甲 -专利权人：航天恒星科技有限公司
申请日： 2015-12-04 - 公布日： 2016-04-06 - 主分类号： G01S19/30 文献下载
摘要：本申请提供一种信号捕获方法，该方法包括：确定分段控制字；根据所述分段控制字确定累加控制信号；根据所述累加控制信号输出累加结果，所述累加结果包括即时支路的累加结果、超前支路的累加结果和滞后支路的累加结果；根据所述即时支路的累加结果调整载波环；根据所述超前支路的累加结果和所述滞后支路的累加结果调整码环。本申请在不改变传统导航接收器结构的前提下，实现输出累加量时长可调整，变相的实现了可配置调整的环路的牵引范围和累加量的累加时长，可同时适应高动态或高灵敏度的应用场景，有效降低了导航信号的捕获时间，提高了导航信号的捕获效率
信号捕获方法装置

[发明专利]一种GNSS信号载波跟踪方法及装置-CN201710109579.9有效
发明人：吴骏 -专利权人：深圳市中兴微电子技术有限公司
申请日： 2017-02-27 - 公布日： 2020-06-09 - 主分类号： G01S19/29 文献下载
摘要：本发明公开了一种GNSS信号载波跟踪方法，包括：对解扩复信号进行第一相干累加操作获得第一相干累加结果，并进行第二相干累加操作获得第二相干累加结果；所述第一相干累加操作包括：在相干累加前对上一第一相干累加结果按照第一相位间隔进行旋转，所述第二相干累加操作包括：在相干累加前对上一第二相干累加结果按照第二相位间隔进行旋转；确定进行第一相干累加操作的次数和第二相干累加操作的次数都达到第一预设值时，将第一相干累加结果设定为第一目标相干累加结果，并将第二相干累加结果设定为第二目标相干累加结果；并根据第一目标相干累加结果和第二目标相干累加结果，调整参考频率复信号的频率。
一种 gnss 信号载波跟踪方法装置

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